SystemVerilogによるFPGA/ディジタル回路設計入門
Artículo nº.: 218204621

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AWG 57

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  • SystemVerilogによる回路設計を実践的に解説 SystemVerilogによるFPGA/ASIC 設計方法を解説する入門書です。 SystemVerilogは、はデジタル回路設計のデファクトスタンダードであるVerilog HDLを拡張した言語で、検証に関する機能が強化されています。Verilog HDLは、ライバルであるVHDLに比べて比較的書きやすい言語といわれています。 本書は、若い技術者や学生向けに最近のSystemVerilogによるデジタル回路設計を解説するものです。FPGAへの実装やデジタル回路自体の基礎からSystemVerilogによるRISC V(リスク ファイブ)設計、Verilog HDLと比較しての注意点など、実践的な内容を解説しています。
Publisher オーム社
Publication date November 25, 2023
Language Japanese
Print length 192 pages
ISBN-10 4274231011
ISBN-13 978-4274231018
Item Weight 1 g
Dimensions 7.17 x 0.47 x 9.25 inches (18.2 x 1.2 x 23.5 cm)

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SystemVerilogによるFPGA/ディジタル回路設計入門

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小林 和淑 (Consultant Editor, Author), 寺澤 真一 Integrated Editorial Review

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